橙网站,网站导航栏效果,建设部网站监理注销查询,备案新增网站备案名称#xff1a;Quartus调用FIFO-IP核#xff0c;完成数据的求和
软件#xff1a;Quartus
语言#xff1a;Verilog
代码功能#xff1a;
题目#xff1a;FIFO-IP核的调用
主要内容#xff1a;调用两个FIFO-IP核#xff0c;完成2行数据的求和
技术参数#xff1a…名称Quartus调用FIFO-IP核完成数据的求和
软件Quartus
语言Verilog
代码功能
题目FIFO-IP核的调用
主要内容调用两个FIFO-IP核完成2行数据的求和
技术参数两行数据值的输入可通过拨码开关实现分别存储于2个FIFO依次读取2个FIFO的数据求和并将结果通过数码管显示
本代码已在DE1-SOC开发板验证开发板照片
板子.jpg
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FIFO-IP核的调用 主要内容调用两个FIFO-IP核完成2行数据的求和 技术参数两行数据值的输入可通过拨码开关实现分别存储于2个FIFO依次读取2个FIFO的数据求和并将结果通过数码管显示名称Quartus调用FIFO-IP核完成数据的求和代码在文末付费下载软件Quartus语言Verilog代码功能题目FIFO-IP核的调用主要内容调用两个FIFO-IP核完成2行数据的求和技术参数两行数据值的输入可通过拨码开关实现分别存储于2个FIFO依次读取2个FIFO的数据求和并将结果通过数码管显示本代码已在DE1-SOC开发板验证开发板照片板子.jpg演示视http://www.hdlcode.com/index.php?mhomecViewaindexaid205
部分代码展示
//调用两个FIFO-IP核完成2行数据的求和
//技术参数两行数据值的输入可通过拨码开关实现
//分别存储于2个FIFO依次读取2个FIFO的数据求和
//并将结果通过数码管显示
module FIFO_add(
input clk,//时钟
input rst_n,//复位
input [7:0] sw,//开关输入数据
input key_1,//写数据1按下将开关数据写入FIFO1
input key_2,//写数据2按下将开关数据写入FIFO2
input key_3,//读FIFO并求和
output [6:0] HEX0,//数码管0
output [6:0] HEX1, //数码管1
output [6:0] HEX2 //数码管2
);
wire [8:0] add_data;//和
//FIFO控制模块
FIFO_ctrl i_FIFO_ctrl(
. clk(clk),//时钟
. rst_n(rst_n),//复位
. sw(sw),//开关输入数据
. key_1(key_1),//写数据1按下将开关数据写入FIFO1
. key_2(key_2),//写数据2按下将开关数据写入FIFO2
. key_3(key_3),//读FIFO并求和
. add_data(add_data)//和
);
//数码管显示模块
segment i_segment(
. clk(clk),
. add_data(add_data),//和
. HEX0(HEX0),//数码管-低亮
. HEX1(HEX1),//数码管-低亮
. HEX2(HEX2)//数码管-低亮
);
endmodule//数码管显示模块
module segment(
input clk,
input [8:0] add_data,//和
output reg [7:0] HEX0,//数码管-低亮
output reg [7:0] HEX1,//数码管-低亮
output reg [7:0] HEX2 //数码管-低亮
);
reg [3:0] data_one4d0;
reg [3:0] data_ten4d0;
reg [3:0] data_hun4d0;
always (posedge clk )
begin
data_one add_data %10;//个位
data_ten add_data /10%10;//十位data_hun add_data /100;//百位
end
//段选输出
always (posedge clk)
begin
case (data_one) //显示码
8d0: HEX0 8b1100_0000;
8d1: HEX0 8b1111_1001;
8d2: HEX0 8b1010_0100;
8d3: HEX0 8b1011_0000;
8d4: HEX0 8b1001_1001;
8d5: HEX0 8b1001_0010;
8d6: HEX0 8b1000_0010;
8d7:设计文档
设计文档.doc
1. 工程文件 2. 程序文件 3. 程序编译 4. RTL图 5. 管脚分配 6. Testbench 7. 仿真图
