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本次实验通过电脑上的网络调试助手#xff0c;将命令帧进行发送#xff0c;然后通过ACZ7015开发板上的以太网芯片接收#xff0c;随后将接收到的数据转换成命令#xff0c;从而实现对ACM9238模块采样频率、数据…ACM9238 高速双通道ADC模块自助服务手册AD9238 一、实验目的
本次实验通过电脑上的网络调试助手将命令帧进行发送然后通过ACZ7015开发板上的以太网芯片接收随后将接收到的数据转换成命令从而实现对ACM9238模块采样频率、数据采样个数以及采样通道的配置。配置完成之后ACM9238模块开始采集数据将采集的数据存储至ddr中然后通过网口以UDP协议传输到电脑。用户可以在电脑上通过网口调试工具进行指令的下发并以文件的形式保存接收到的数据然后使用MATLAB软件进行进一步的数据处理分析。 二、AD9238
模块在各方面参数性能上与AD9226保持一致。但是在设计上优化了信号调理电路将单端信号先转成差分信号再送入ADC转换已获得更小的采样误差。 功能参数 1、±5V电压输入范围 2、每通道65Msps最高采样速率 3、每通道12位输出 三、DDR3大容量存储器件
DDRDouble Data Rate双倍速率DDR SDRAM双倍速率同步动态随机存储器人们习惯称为DDR其中SDRAM 是Synchronous Dynamic Random Access Memory的缩写即同步动态随机存取存储器。而DDR SDRAM是Double Data Rate SDRAM的缩写是双倍速率同步动态随机存储器。摘录ddr双倍数据速率_百度百科 (baidu.com)
1.相关知识
PL通用可编程逻辑FPGA。
PS两个 Cortex-A9 核、 IO 外设、各类硬核控制器等资源在内的 SOC 处理系统。 PS部分的DDR3主要用作ARM CPU的内存系统ARM CPU的程序可以在该DDR3中运行PS部分的DDR3存储器使用不需要也不能调用MIG IP来控制只需要在设计中添加ZYNQ7 Processing System 组件并配置好DDR相关的参数即可使用。ACZ7015开发板的DDR型号为MT41K256M16 RE-125。 PL部分如果要使用DDR3存储器
第一种首先在PL部分要设计DDR3部分电路并且需要通过在IP Catlog中调用MIG IP来创建DDR3控制器。
第二种PL通过AXI44个高性能数据交互端口High-Performance Ports接口使用PS的DDR3存储器空间。 2.架构优势
PL通过HP端口写入到PS侧DDR3中的数据不仅PL可以再读回来同时PS侧的ARM CPU也可以读写这些数据。相同的道理PS侧在某些区域写入的数据PL侧也可以从该区域读出来使用。
3.直接使用DDR控制器可能会遇到的实际问题 如何确保读写DDR时数据的有效性以及读写传输的高效性
3.1读写时钟频率不同跨时钟域怎么办单一Ui时钟能满足数据读写侧速率需求吗
DDR控制器的时钟频率恒定但是大部分硬件读写有自身的固定工作频率、数据读写频率并且有可能与DDR时钟频率不一致。有可能导致DDR控制器无法满足读写硬件的速率需求进而数据交互存在跨时钟域还会导致DDR读写错误。
3.2读写数据不连续怎么办
在速率满足的情况下还可能存在外设发送接收数据并不连续的问题。
3.3读写数据位宽不同怎么办
DDR典型数据位宽128位但外设一般为8位或16位。
以上问题通过在读写段各添加一个FIFO解决进而引出AXI转化模块。
