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题目描述#xff1a;
存在两个同步的倍频时钟clk0 clk1,已知clk0是clk1的二倍频#xff0c;现在要设计一个切换电路#xff0c;sel选择时候进行切换#xff0c;要求没有毛刺。
信号示意图#xff1a; 波形示意图#xff1a; 输入描述#xff1a;
clk0 clk1为时…描述
题目描述
存在两个同步的倍频时钟clk0 clk1,已知clk0是clk1的二倍频现在要设计一个切换电路sel选择时候进行切换要求没有毛刺。
信号示意图 波形示意图 输入描述
clk0 clk1为时钟
rst为低电平复位
sel 是时钟选择器
输出描述
clk_out 信号输出
timescale 1ns/1nsmodule huawei6(input wire clk0 ,input wire clk1 ,input wire rst ,input wire sel ,output reg clk_out
);
//*************code***********//reg p0, p1;always (negedge clk0, negedge rst) begin // sel切换在clk低电平处切换clk可避免毛刺if (~rst) beginp0 1b0;end else beginp0 ~sel ~p1;endendalways (negedge clk1, negedge rst) begin if (~rst) beginp1 1b0;end else beginp1 sel ~p0;endendalways (*) beginclk_out (p0 clk0) | (p1 clk1);end//*************code***********//
endmodule
