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合成后项目以合成网表、完全生成的块设计、完全生成的IP以及相应的约束。然后#xff0c;您可以分析、布局和实施设计
注意#xff1a;您可以使用XST或第三方合成工具来创建合成网表。
重要#xff01;使用EDIF和NGC文件时#xff0c;顶部单元格名称必…创建后期合成项目
合成后项目以合成网表、完全生成的块设计、完全生成的IP以及相应的约束。然后您可以分析、布局和实施设计
注意您可以使用XST或第三方合成工具来创建合成网表。
重要使用EDIF和NGC文件时顶部单元格名称必须与文件名称相匹配。
1.按照创建项目中的步骤进行操作。
2.在“项目类型”页面中选择“后期合成项目”然后单击“下一步”。
注意如有必要您可以选择此时不指定来源。这将跳过添加的步骤设计源使您能够选择目标零件并创建项目。
3.在“添加网表源”页面中使用以下选项指定要读取的网表文件识别包含顶级模块的文件并定义要搜索的较低级别的目录模块网表然后单击下一步。
•添加文件调用文件浏览器以便您可以选择网表文件结构化VerilogSystemVerilog、EDIF或NGC、BD文件和XCI文件IP的所有输出产品必须生成包括DCP或设计检查点文件DCP添加到项目
建议始终使用XCI文件参考IP。始终参考块设计使用BD文件不建议只读取IP或BD DCP文件。而DCP会包含约束它不提供IP或BD可以提供的其他输出产品并且可能需要的例如ELF、COE和Tcl脚本。
注意为包含顶级网表的文件启用“顶部”单选按钮。
•添加目录调用目录浏览器以便您可以选择要搜索的目录模块。指定目录中具有有效源文件扩展名的文件将添加到项目
•删除该按钮从列表中删除选定的源文件和目录。
•上移/下移按列表顺序上移/下移文件或目录。的顺序文件会影响处理顺序。
•将源复制到项目中将文件复制到本地项目目录中而不是引用原始文件。如果使用“添加目录”添加源文件的目录将文件本地复制到项目中时将维护目录结构。对于有关详细信息请参阅使用远程源或将源复制到项目中。
•从子目录添加源在目录的子目录中查找网表文件使用Add Directories指定。 4.可选在“添加约束”页面中设置以下选项然后单击“下一步”
•添加文件调用文件浏览器以便选择要添加到项目中的SDC或XDC文件。
•创建文件为项目创建一个新的顶级XDC文件。
•删除从约束列表中删除选定的文件。
•上移/下移按列出的顺序向上或向下移动约束文件。命令依赖于订单约束的最后一个读取命令覆盖的效果早期命令。
•将约束复制到项目中将约束文件复制到本地项目目录中而不是引用原始文件。
注意在与RTL或网表源文件关联的相同目录中找到的任何SDC或XDC文件将自动列为要添加到项目中的约束文件。
5.在Default Part默认零件页面中选择AMD零件或TDP板然后单击Next下一步
•部件列出可用的设备。有关设备资源的信息显示在表中看法您可以使用“产品类别”、“族”、“子族”、包、速度来过滤列表等级和温度等级过滤器。您也可以使用“搜索”字段来查找特定的设备。
•板列出可用的TDP板以及板上使用的AMD部件。信息关于表视图中显示的设备资源例如I/O引脚数、LUT数量和触发器以及可用的块RAM。您可以使用供应商、显示来筛选列表名称和Board Rev过滤器。您也可以使用“搜索”字段来查找特定的电路板零件。
6.在“新建项目摘要”页面中查看定义项目的选定选项以及单击“完成”。
创建I/O规划项目
您可以将I/O规划项目用于设备探索和规划的设备引脚输出正在进行的系统级设计。您可以在完成之前创建此类型的项目HDL或合成的网表。例如这允许您与交换设计信息系统级或PCB设计者。有关I/O规划的更多信息请参阅VivadoDesign Suite用户指南I/O和时钟规划UG899。
1.按照创建项目中的步骤进行操作。
2.在“项目类型”页面中选择“I/O规划项目”然后单击“下一步”。
3.可选在“导入端口”对话框中使用以下选项为选择文件导入I/O端口定义和约束然后单击“下一步”。
•导入CSV选择具有I/O端口定义的CSV文件。有关CSV的更多信息文件请参阅Vivado Design Suite用户指南I/O和时钟规划UG899。
•导入XDC仅选择具有I/O端口相关约束的XDC。
•此时不导入I/O端口创建一个空项目。您可以创建或导入I/O稍后。
注使用RTL项目可以使用RTL头文件或源文件对设计执行I/O引脚规划。 4.在Default Part默认零件页面中选择AMD零件或TDP板然后单击Next下一步
•部件列出可用的设备。有关设备资源的信息显示在表中看法您可以使用“产品类别”、“族”、“子族”、包、速度来过滤列表等级和温度等级过滤器。您还可以使用“搜索”字段查找特定设备
•板列出可用的TDP板以及板上使用的AMD部件。信息关于表视图中显示的设备资源例如I/O引脚数、LUT数量和触发器以及可用的块RAM。您可以使用供应商、显示来筛选列表名称和Board Rev过滤器。您也可以使用“搜索”字段来查找特定的电路板零件。
5.在“新建项目摘要”页面中查看您选择的用于定义项目的选项以及单击“完成”创建并打开项目。
注有关内存IP I/O规划的更多信息请参阅Vivado Design Suite用户指南I/O和时钟规划UG899。
