移动开发网站开发区别,wordpress 3d旋转,旅游网站后台模板,wordpress 定时任务怎么开发http://blog.sina.com.cn/s/blog_5f6fcfce01012w4g.html IP核概述 利用IP核设计
电子系统
#xff0c;引用方便#xff0c;修改基本元件的功能容易。具有复杂功能和商业价值的IP核一般具有知识产权#xff0c;尽管IP核的市场活动还不规范#xff0c;但是仍有许多
集成电路… http://blog.sina.com.cn/s/blog_5f6fcfce01012w4g.html IP核概述 利用IP核设计
电子系统
引用方便修改基本元件的功能容易。具有复杂功能和商业价值的IP核一般具有知识产权尽管IP核的市场活动还不规范但是仍有许多
集成电路设计
公司从事IP核的设计、开发和营销工作。IP核有两种与工艺无关的VHDL程序称为
软核
具有特定电路功能的集成电路版图称为硬核。硬核一般不允许更改利用硬核进行集成电路设计难度大但是容易成功流片。 编辑本段IP核分类 IP内核的三种类型 IP内核可以在不同的硬件描述级实现由此产生了三类IP内核
软核
、
固核
和
硬核
。这种分类主要依据产品交付的方式而这三种IP内核实现方法也各具特色。 软核
是用VHDL等硬件描述语言描述的功能块但是并不涉及用什么具体电路元件实现这些功能。软IP通常是以硬件描述语言HDL源文件的形势出现应用开发过程与普通的HDL设计也十分相似只是所需的开发硬
软件环境
比较昂贵。软IP的设计周期短设计投入少。由于不涉及物理实现为后续设计留有很大的发挥空间增大了IP的灵活性和适应性。其主要缺点是在一定程度上使后续工序无法适应整体设计从而需要一定程度的软IP修正在性能上也不可能获得全面的优化。由于软核是以
源代码
的形式提供尽管源代码可以采用加密方法但其
知识产权保护
问题不容忽视。 硬核
提供设计阶段最终阶段产品掩模。以经过完全的布局布线的网表形式提供这种硬核既具有可预见性同时还可以针对特定工艺或购买商进行功耗和尺寸上的优化。尽管硬核由于缺乏灵活性而可移植性差但由于无须提供寄存器转移级(RTL)文件因而更易于实现IP保护。 固核
则是软核和硬核的折衷。大多数应用于FPGA的IP内核均为软核软核有助于用户调节参数并增强可复用性。软核通常以加密形式提供这样实际的 RTL对用户是不可见的但布局和布线灵活。在这些加密的软核中如果对内核进行了参数化那么用户就可通过头文件或图形用户接口(GUI)方便地对参数进行操作。对于那些对时序要求严格的内核(如PCI接口内核)可预布线特定信号或分配特定的布线资源以满足时序要求。这些内核可归类为固核由于内核是预先设计的代码模块因此这有可能影响包含该内核的整体设计。由于内核的建立(setup)、保持时间和握手信号都可能是固定的因此其它电路的设计时都必须考虑与该内核进行正确地接口。如果内核具有固定布局或部分固定的布局那么这还将影响其它电路的布局。 编辑本段IP核介绍 IP知识产权核将一些在数字电路中常用但比较复杂的功能块如
FIR滤波器
、SDRAM控制器、PCI接口等设计成可修改参数的模块。IP核的重用是设计人员赢得迅速上市时间的主要策略。随着CPLD/FPGA的规模越来越大设计越来越复杂IC的复杂度以每年55%的速率递增而设计能力每年仅提高21%设计者的主要任务是在规定的时间周期内完成复杂的设计。调用IP核能避免重复劳动大大减轻工程师的负担因此使用IP核是一个发展趋势。 IP核包括硬IP与软IP。可配置IP是参数化后的可重定目标IP其优点是可以对功能加以裁剪以符合特定的应用。这些参数包括总线宽度、存储器容量、使能或禁止功能块。 硬IP最大的优点是确保性能如速度、功耗等。然而硬IP难以转移到新工艺或集成到新结构中是不可重配置的。 软IP是以综合形式交付的因而必须在目标工艺中实现并由系统设计者验证。其优点是源代码灵活可重定目标于多种制作工艺在新功能级中重新配置。 不过目前大多数库是收费的但也可以从网上下载一些免费的IP核。 编辑本段用IP核实现的D/A转换器的功能及特点 数字到模拟转换器DACs将一个二进制数转换为与之对应的电压值目前常用的
D/A转换器
都是由电阻或电容加权网络、受码元控制的开关和基准电压或电流源组成。当D/A转换器需要转换的信号每次取样字长很长时对这些电路的精度要求很高并且还必须在整个温度范围和整个使用寿命期间内保持电路参数的稳定。例如一个16位的D/A转换器其MSB的精度必须在1/2 16以内这是很困难的。所以需寻求一种中保持高分辨率又可降低对电路精度和稳定度要求的方法。 可综合的Delta-Sigma DAC术语Delta-Sigma分别指算术差与和即Δ-∑DAC是Xilinx公司提供的免费IP核可从网上下载得到。 Delta-Sigma DAC使用数字技术因而它不受温度的影响并且能在一片
可编程逻辑器件
中实现。避免在D/A转换器中使用匹配电阻不仅能更便宜而且其转换是线性的。Delta-Sigma DAC实际上是高速单个位的DAC用数字反馈技术在输出端产生一串脉冲。脉冲串中信号为高电平的时间部分与二进制输入成比例当这个脉冲串通过一个模拟低通滤波器后就得到一个模拟输出信号。 图1是一个典型的可编程逻辑器件实现的DAC的顶层电路图输入信号有复位信号、时钟信号以及二进制数据总线。输出DACoutDrvr驱动一个外部的低通滤波器Vout能从0VVcco。这里Vcco是FPGA I/O块的供电电压。输入/输出详细说明如表1所列。 表1 输入输出描述表信号 方向 描 述 DACOUT 输出 驱动外部低通滤波器的脉冲串通过一个输出驱动器 DACIN 输入 数字输入总线值必须设置成钟的正沿 clk 输入 正沿有效 Reset 输入 复位信号初始化SigmaLatch和输出D触发器 DAC的二进制输入是一个无符号数。“0”代表最低电压输出的模拟电压也只有正的。“0”输入产生0V输出输入端全“1”则输出近似达到Vcco。 图2是Delta-Sigma DAC的原理框图二进制输入的位宽是可变的。为简单起见电路原理图描述了一个8位二进制输入的DAC。 在这个器件中
二进制加法器
用来产生和也用来产生差。尽管Delta Adder的输入是无符号数两个加法器的输出却都是有符号数。Delta Adder计算DAC输入和当前DAC输出的差并用一个二进制数表示。因为DAC的输出是一个单个的位因此它不是1就是0。如图2所示当输入加上由Sigma Latch的输出的两个拷贝与0构成的10位数就产生差值这也补偿了DACIN是无符号数的事实。Sigma Adder将它原来的输出保存在Sigma Latch中与当前的Delta Adder的输出相加。 图1
中输出电压与输入电压的关系为 VOUT(DACIN/(2MSBI1))×VCCO 式中单位为V。 例如对于一个8位DACMSBI7最后的输出是这样DACIN输入是0则输出也是0DACIN输入是十六进制数FF时输出值为最大(255/256)×Vcco。 阻容低通滤波器适合多数应用需要一个简单的阻容低通滤波器就能工作得很好。 Vs的定义是DAC输入增加或减少时在Vout端产生变化的
绝对值
。对一个8位DACVs等于1/256×Vcco。 Vout能够产生在0VVcco之间可变的电压具体的值由DACIN的位宽和输入的数值决定。 Delta-Sigma DAC适合需要相对高精度的低频应用。在这种应用中电压不会很快地变化因此RC的时间常数可以很大以减小噪声。 这种DAC最广泛的应用就是产生通常直流电压。这包括电压控制振荡器、电压控制运算放大器、I/O参数电压、可编程电压源、波形发生器正弦、三角等、A/D转换中的参考电压等。 Delta-Sigma DAC是一个例子说明高速可编程逻辑器件能用于混合信号系统以减少元件的数量。可编程逻辑器件的速度和密度使它们成为模拟信号产生和处理方面理想的元件。 用VHDL语言编写的程序library ieee; use ieeestd_logic_1164.all; use ieee.std_logic_arith.all; use ieee.std_logic_unsigned.all; entity dac_ds is port(reset :in std_logic; clk :in std_logic; din :in std_logic_vector(7 downto 0);--Signed integer dout :out std_logic; ); end dac_ds; architecture arch_dac_ds of dac_ds is signal error :std_logic_vector(9 downto 0);--Error accumulator is 2 bits larger constant zeros:std_logic_vector(7 downto 0):(others0); begin process(reset,clk,din) variable val :std_logic_vector(9 downto 0); begin if reset1then error(others0); dout0; elsif clkevent and clk1 then --val:dinerror;din is sign extended to nbits2 val:(din(dinhigh)din(dinhigh)din)error; if val(valhigh)0then dout1; errorval(11 zeros); else dout0; errorval(01zeros); end if; end if; end process; end arch_dac_ds; 4 芯片的选择和配置选择MAX7000S系列可编程逻辑器件编译后由MAXPLUS II
软件
自动配置进EMP7032SLC44芯片将生成的目标文件通过编程电缆对器件进行编程。 将该IP核实现的D/A转换器用于新型智能电阻炉温度控制仪中因为调节炉温的信号不要求变化很快因此DAC的输入二进制信号为缓变信号。对于这种低频应用可以将RC时间常数取得较大以减小噪声。这样可综合的VHDL语言Delta-Sigma DAC模块配置进EMP7032芯片后达到了预期的效果。 编辑本段IP核再使用的十大注意事项 知识产权IP的再使用是设计组赢得迅速上市时间的主要策略因为现在留给设计者完成诸如
蜂窝电话
和Internet
路由器
等热门IC设计的周期只有3个月。设计者还需面对这样一个严酷的现实即IC的复杂度以每年55%的速率递增而设计能力每年仅提高21%。 为系统设计者专门制作的再使用IP弥补了这方面的不足。再使用既为IP建立者也为系统设计者提供一种共享最佳IP核和主导模块的方法。系统设计者的主要任务是在规定的周期时间内研发出复杂的设计。这只有采用新设计方法和完全不同的芯片设计理念才能完成。IP再使用已经成为系统设计方法的关键所在。 1. 再使用标准的选择 标准是再使用的基础。在设计一个系统时可供工程人员考虑的工业标准很多比如半导体再使用标准SRS它是对各种工业再使用创议标准的补充,提出这些创议标准的组织包括“虚插座接口联盟VSIA”等。再使用标准为IP设计流程中的各阶段提供规则、指南和接口方法。它是高效设计方法的一个里程碑,让可再用IP快捷地、即插即用地集成到系统解决方案成为可能。 再使用标准通常涉及到许多方面如系统级设计、结构、实现、验证以及文件编制和可交付清单等与IP有关的事项。例如结构分类目录解决片上或片外的接口。实现分类目录通过HDL代码标准、物理表示、单元库以及模拟子单元集中解决如何建立IP的问题。功能验证及可测试设计DFT标准则包含在验证分类目录中。 2. IP核的选择 根据IP使用的划分IP建立者可按下列三种形式设计IP可再用、可重定目标以及可配置。可再用IP是着眼于按各种再使用标准定义的格式和快速集成的要求而建立的便于移植更重要的是有效集成。可重定目标IP是在充分高的抽象级上设计的,因而可以方便地在各种工艺与结构之间转移。可配置IP是参数化后的可重定目标IP其优点是可以对功能加以裁剪以符合特定的应用。这些参数包括总线宽度、存储器容量、使能或禁止功能块。硬IP与软IP的意图不同因而对IP的开发和在这之后的IP的集成采用不同的方法。 3. 硬IP 硬IP对功率、体积和性能进行了优化并映射至特定的工艺。具体实例包括已完成布局布线的网表以特定工艺库或全定制物理布图或两者之组合。硬IP是特定工艺来实现的通常用GDSII格式表示。硬IP可以再使用且由于它已处于设计表示的最底层因而最容易集成。硬IP已完全用目标工艺实现是按十分接近于
标准单元库
元件的形式交付的故而允许设计者将IP快速地集成在衍生产品中。硬IP最大的优点是确保性能如速度、功耗等。然而硬IP难以转移到新工艺或集成到新结构中是不可重配置的。 4. 软IP 软IP是以综合形式交付的因而必须在目标工艺中实现,并由系统设计者验证。其优点是源代码的灵活性它可重定目标于多种制作工艺在新功能级中重新配置。 由于设计以高层次表示因而软IP是可再用的易于重定目标和重配置,然而预测软IP的时序、面积与功率诸方面的性能较困难。为了实现最高效率的再使用并减少集成时间IP应从软件源代码开始;而为了确保性能复杂IP应以硬IP的形式共享。 5. 再使用的软插接 软插接是开发符合再使用标准IP的过程它应成为建立新IP设计流程的组成部分。过程需要有关IP深层的知识因此只有IP建立者最熟知IP块有能力建立这些些概念在时序分析时去除假通路并最终确定结果的正确性。与DFT一样软插接会修改现有的设计流程来适应再使用设计和生成附加可交付项,因此在设计流程中应及早考虑再使用事项。 6. 再使用的提供与获取 IP资源库为IP建立者和系统设计者提供共享和使用IP的基础设施。这个系统应让IP建立者和系统设计者共享硬和软两方面的可再用IP。资源库提供多场所的全方位访问,系统集成的全方位开发。它也是
设计师
搜索、选择、将再使用块集成到自己系统中的快捷而又简便的途径。 资源库基础设施还应开辟一个区域,让系统开发者提供反馈、出错报告、错误改正及资源库中任何有关IP块的注解。反馈信息块建立者对错误的修复与改进说明一起是块数据库列表的一部分。 7. IP块的认证 认证能确定IP块是否符合相关的再使用标准。它提供一把表征块再使用质量的尺度,应在IP进入资源库前完成。由于IP建立者熟知IP他应测试块概念间的一致性以及与工具、库以及硬件平台的兼容性。一个独立的认证小组通过对可交付性、再使用性以及出错历史记录的随机抽样,预测IP核的质量和可靠性,定出IP的分类等级。这个等级让设计者有一个总体概念如IP符合标准的准确性有多好再使用需多大的软插接工作量。 8.IP集成的优化 对IP核的再使用建立者需软插接IP、进行认证、将它存放在系统设计者能访问的资源库中。自动化工具提供多种手段加速软插接和资源库的操作认证和集成过程的部分自动化。工具制造商力争实现更多的自动化。在理想情况下全部IP块可从资源库中按需供给。 9.设计周期的加速 目前设计者几乎没有能力在三个月设计周期内开发出合乎规格的新产品。如果对每个产品族建立一个设计平台设计组就能充分发挥平台的作用开发出产品的衍生品种。一种有效的再使用方法应让可再使用IP的开发作为平台的一部分并将IP块快速地集成到衍生品种。 10.支持基础设施 一旦IP开始普遍使用提供该IP的支持是必要的。建立者继续拥有IP因为支持它需要深层的知识。建立者负责IP的更新将最新版本放置在资源库中。IP由为系统设计者服务的认证组重新认证。此外,建立者还应在系统设计者集成IP遇到困难时提供必需的支持。
